图书介绍

Verilog HDL实验练习与语法手册 第2版【2025|PDF|Epub|mobi|kindle电子书版本百度云盘下载】

Verilog HDL实验练习与语法手册 第2版
  • 夏宇闻编著 著
  • 出版社： 北京：高等教育出版社
  • ISBN：7040171996
  • 出版时间：2006
  • 标注页数：191页
  • 文件大小：6MB
  • 文件页数：199页
  • 主题词：数字系统－系统设计－高等学校－教学参考资料；硬件描述语言，VHDL－程序设计－高等学校－教学参考资料

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图书目录

目录1

第一部分　设计示范与实验练习1

练习一　简单的组合逻辑设计1

练习二　简单分频时序逻辑电路的设计4

练习三　利用条件语句实现计数分频时序电路6

练习四　阻塞赋值与非阻塞赋值的区别8

练习五　用always块实现较复杂的组合逻辑电路10

练习六　在Verilog HDL中使用函数13

练习七　在Verilog HDL中使用任务task声明语句15

练习八　利用有限状态机进行时序逻辑的设计18

练习九　利用状态机实现比较复杂的接口设计21

练习十　通过模块实例调用实现大型的设计26

练习十一　简单卷积器的设计34

练习十二　利用SRAM设计一个FIFO50

第二部分　Verilog硬件描述语言参考手册60

一、关于IEEE 1364标准60

三、语法总结61

二、Verilog简介61

四、编写Verilog HDL源代码的标准64

五、设计流程65

六、按字母顺序查找部分66

七、编译器指示（Compiler Directives）138

八、系统任务和函数（System Task and Function）143

第三部分　IEEE Verilog 1364-2001标准简介164

一、Verilog语言发展历史回顾164

二、IEEE 1364-2001 Verilog标准的目标164

三、新标准使建模性能得到很大提高165

四、提高了ASIC/FPGA应用的正确性176

五、编程语言接口（PLI）方面的改进179

六、总结179

附录一 A/D转换器的Verilog HDL模型和建立模型所需要的技术参数180

附录二 2K×8位异步CMOS静态RAM HM-65162模型185

参考文献191

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